基于FPGA的串⾏差分（LVDS）⾼速ADC接⼝
ddim1、低电压差分信号(Low-Voltage Differential Signaling,LVDS)是⼀种电⼦信号系统，可满⾜现今对⾼性能数据传输英语的需求，同时系统供电电压减低到2V。LVDS是采⽤差分的传输⽅式，电压输出与接收需要100欧姆的终端阻抗，采⽤点对点(Point-to-Point)与分⽀(Multi-Drop)的连接⽅式。
2、串⾏差分(LVDS)⾼速ADC⾃动将采样时钟倍频，以便产⽣合适的LVDS串⾏数据速率。它提供⼀个数据时钟输出(DCO)⽤于在输出端捕获数据，以及⼀个帧时钟输出(FCO)⽤于发送新输出字节信号。
3、xilinx-7系列FPGA的SelectIO可以配置各种不同的电⽓接⼝，同时SelectIO还提供了丰富的逻辑资源⽤于⾼性能数据传输。
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详细介绍请参考张颂文个人资料
4、在具体代码实现中，发现在采集FCO时有发⽣数据乱码的情况；开关机后⼜能正确采集。这⾥先解说词范文
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