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上海交通大学硕士学位论文
全芯片时钟网络的综合与优化方法
硕士研究生：黄伟坚
学号：1082109015
大班科学活动导 师：施国勇教授
副导师：
申请学位：工学硕士
学科：电路与系统
所在单位：微电子学院
答辩日期：2010年1月
授予学位单位：上海交通大学
此研究由国家自然科学基金（编号60876089）资助
Disrtation Submitted to Shanghai Jiao Tong University
for the Degree of Master
小花怎么剪ON GLOBAL CLOCK MESH SYNTHESIS AND OPTIMIZATION
Candidate：Weijian Huang
Student ID:1082109015
Supervisor：Prof. G. Shi
Assistant Supervisor:Prof.
Academic Degree Applied for：Master of Engineering
word文本框
Speciality：Circuits and System
Affiliation：School of Microelectronics
Date of Defence：Jan, 2010
Degree-Conferring-Institution：Shanghai Jiao Tong University
上海交通大学
学位论文原创性声明
本人郑重声明：所呈交的学位论文《全芯片时钟网络的综合与优化方法》，是本人在导师的指导下，独立进行研究工作所取得的成果。除文中已经注明引用的内容外，本论文不包含任何其他个人或集体已经发表或撰写过的作品成果。对本文的研究做出重要贡献的个人和集体，均已在文中以明确方式标明。本人完全意识到本声明的法律结果由本人承担。马齿苋的作用与功效
狮子资料学位论文作者签名：
日期：年月日
排卵期褐色分泌物怎么回事上海交通大学
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日期： 年 月 日 日期： 年 月 日
上海交通大学硕士学位论文
全芯片时钟网络的综合与优化方法
摘要
随着半导体工艺技术的不断进度，沟道尺寸的不断缩小，65纳米和45纳米已成为主流的工艺技术，并向着32和22纳米向前发展。然而，由于工艺尺寸缩小造成的不确定性的对芯片时钟的干扰越来越大，时钟设计已成为整个后端设计的重点和难点。传统的时钟树（clock tree）综合已越来越难以满足当今设计对时钟综合提出的功耗和时钟偏差（clock skew）等要求。网格型时钟由于抗干扰能力强，时钟偏差小的特点，越来越受到工业界的关注，网格型时钟分布已经成功应用于大型的芯片设计，如600-MH Alpha；IBM G5 S/930；Power4；Power PC; SUN Sparc V9。但是由于没有成熟完善的工具支持自动化的网格型时钟综合，限制了网格型时钟的广泛应用。
本课题将实现网格型时钟（clock mesh）的整个综合和优化流程，实现100%的全自动化网格型时钟设计。本文提出了这个综合和优化流程的框架，主要包括以下六个步骤：网格规划、结构定位、局部布线、缓冲器插入、约束验证和缓冲器优化。本文将对实现上述每个步骤的算法加以研究，使时钟网格在满足时序和功耗约束的两个重要前提下尽可能地优化，同时总结出时钟网格的一般特性。实验结果表明，该自动化流程在学术界标准的测试案例中表现出了较高的质量，综合后的时钟网格在时序和功耗方面满足了严格的约束要求。
关键词（四号黑体）：时钟综合，时钟网格，局部布线，缓冲器插入，约束验证。
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