Quartus中英文对照(最新)

更新时间:2023-05-03 01:26:47 阅读: 评论:0

2D Median Filter        二维中值滤波器
3rd Party EDA Synthesis        第三方EDA综合工具
3rd Party Formal Verification    第三方一致性验证
A
Active Parallel (AP)        主动并行配置(AP)
ALM                自适应逻辑模块(ALM)
Altera Complete Design Suite    Altera完整设计开发包
Altera Installer    Altera安装工具
Altera Licen S梦见有人坠楼 etup    Altera授权设置
Alpha Blending Mixer    Alpha调配混频器
AN522 version 2.0    AN522 版本2.0
Analysis & Synthesis    分析与综合
Archives    存档
Assignment Editor    约束编辑器
B
Ba Address Register    基址寄存器 (BAR)
Biasing Circuitry    偏置电路
block diagram        结构框图
Board Design and Layout    板级设计及布板
Board Test, Design and Layout    板级测试,设计及布板
Boot Copier    引导复制程序
boundary-scan description language (BSDL)    边界扫描描述语言
burst length    突发长度
burst transfers    突发传输
C
Cache    高速缓存
Capacitance    电容
charge pump    电荷泵
Carry Chain    进位链
Chip Editor    芯片编辑器
Chroma Resampler    色度重采样器
Color Plane Sequencer    色彩平面定序器
Color Space Converter    色彩空间转换器
Common Clock    公共时钟
common mode voltage    共模电压
Common Public Radio Interface(CPRI)    通用公共无线接口
Comm, Interface & Peripherals    通讯,接口及外设
configuration random-access memory(CRAM)    配置数据存储空间/配置RAM
Compile    编译
Component    元件/组件/器件
Configuration (FPGA)    配置(FPGA)
Crosstalk    串扰
Cyclone? III automotive grade devices    Cyclone? III 汽车级器件
D
Data access    数据访问
data path    数据通路
DCFIFO    异步FIFO(DCFIFO)
DDR    DDR (外部存储器接口)
DDR controller    DDR控制器
Deinterleaver Block    解交织器模块
Demonstration Design    示例设计
Design Entry/Planning    设计输入/规划
Design Partition    设计分区
design curity    设计安全
Digital Signal Processing(DSP)    数字信号处理
DLL    延时锁相环(DLL)
down training    下行训练
download manager    下载管理器
DSP Block/Multiplier Block    DSP 块/乘法器块
DSP capabilities    DSP 功能
dual-purpo pins    多功能复用管脚
Dynamic On-Chip Termination (OCT)    动态片内匹配(OCT)
Dynamic parallel termination    动态并行匹配
Dynamic Reconfiguration    动态重配置
Dynamic ries termination    动态串行匹配
E
Electrical Idle    电路空闲
Error Correction Coding (ECC)    纠错代码
Error Message    错误信息
Ethernet    以太网
External Memory Interfaces    外部存储器接口 (IP)
F
Fast Passive Parallel (FPP)    快速被动并行配置(FPP)
Fitter    布局布线器
Filtered Luma Adaptive Algorithm    亮度滤波自适应算法
Functional Blocks    功能模块
G
Gamma Corrector    灰度校正器
General Architecture (Non I/O)    通用架构(非 I/O)
generator    生成器
gerber file    光绘文件
Gigabit Transceiver    千兆速率收发器
Global Clock (GCLK)    全局时钟
GUI    图形界面(GUI)
H
Hard IP    硬核 IP
High-Definition Serial Digital Interface(HD-SDI)    高清晰串行数字接口
High functionality/ high performance    高性能
high-speed rial interface (HSSI)    高速串行接口
High-speed Source-synchronous Interface    高速源同步接口
I
IFF    敌我识别(IFF)
implement    实现
incremental compilation    增量式编译
Inductance    电感
Instruction Set    指令集
In-System/Circuit Programming    在系统编程
Integrated Synthesis    集成综合器
Interleaver Block    交织器模块
Internal Error    内部错误(Internal Error)
Intermediate Frequency(IF)    中频
interpolator    插补器
Interrupt Service Routine    中断服务程序
Interrupts or Ret    中断或复位
Inter-transceiver Block(ITB)    收发器间模块
IOE    I/O单元
IP Spec and Protocol    IP 规格及协议
K
known issue    已知问题
L
latch inference warnings    锁存器推断告警
level shifter    电平转换器
licen/ licensing    许可
link training    链路训练
Logic element    逻辑单元
loop filter    回路滤波器
LUT    查找表/查找表模块(LUT)
M
Memory    存储器
Memory/DSP Blocks Inference    存储器/DSP 块的推断
metadata / meta-data    元数据
modules    模块
Motion Adaptive Algorithm    运动自适应算法
Motion Adaptive Deinterlacing    运动自适应逐行扫描
N
Nios II IDE    Nios II 集成开发环境
O
offt    偏置/偏移量
On-Chip Debug    On-Chip 调试
on-chip memory    片内存储器
P
Pad Placement    垫布局
Parallel Flash Loader    并行Flash加载
Parallel Synthesis    并行综合
part per million (ppm)    百万分率
Passive Serial (PS)    被动串行配置(PS)
patch    补丁
PCI Express-to-DDR2 reference design    PCI Express到DDR2 SDRAM 参考设计
Pha Detector    相位检测器
Physical coding sublayer (PCS)    物理编码子层(PCS)
Physical media attachment (PMA)    物理介质附加子层(PMA)
Physical Synthesis    物理综合
Pin Planning/Management    管脚分配/管理
place and route algorithms    布局及布线算法
Placement Requirements    布局要求
PLL Cascading    PLL级联
PLL Reconfiguration    锁相环重配置
Polypha Algorithm&nbs财务 p;   多相算法
Polypha Scaling Algorithm    多相缩放算法
Post-Scale Counter    后端缩放计数器
Power Analysis/Management    功耗分析及管理
Power Cycle    重上电
Power Supply Design    电源设计 (功耗)
prefetchable    可预取的
programmable duty 词字开头的成语 cycle    可编程占空比
Programming (CPLD/Config Dev)    编程(CPLD/配置器件)
Q
QII Classic Timing Analysis    QII 早期的TAN时序分析器
Quartus II Projects/Revisions    Quartus II 工程/版本管理
Quartus II Stand-Alone Programmer    Quartus II独立编程器
R
Reference Design    参考设计
reference design pack    参考设计包
Recursive Filter    递归滤波器
Root port    root 端口
Round and Saturation Block    舍入与饱和模块
S
Scaled Video Stream    缩放视频流
SCFIFO    同步FIFO(SCFIFO)
Schematic    原理图
Schematic Editor    原理图编辑器
Serial Flash Loader (SFL)    串行闪存加载器(SFL)
Serial protocol    串行协议
Setup/hold    建立/保持(时间)
Setup/hold    建立/保持(时间)
Signal Integrity    型号完整性 (I/O)
slave    从(端/设备)
single-event upt(SEU)    单事件反转

本文发布于:2023-05-03 01:26:47,感谢您对本站的认可!

本文链接:https://www.wtabcd.cn/fanwen/fan/82/519629.html

版权声明:本站内容均来自互联网,仅供演示用,请勿用于商业和其他非法用途。如果侵犯了您的权益请与我们联系,我们将在24小时内删除。

标签:设计   配置   适应   串行   接口
相关文章
留言与评论(共有 0 条评论)
   
验证码:
推荐文章
排行榜
Copyright ©2019-2022 Comsenz Inc.Powered by © 专利检索| 网站地图